招聘人数:6 人
到岗时间:1个月之内
婚况要求:不限婚况
verilog
岗位职责:
1.根据项目需求,定义SOC系统架构;
2.集成和设计SOC系统级模块,包括:Clock/Reset/Interrupt、MMU、GIC及PMU等;
3.配合后端工程师完成SOC系统的时序分析及收敛;
4.配合软件或硬件工程师完成FPGA原型验证及回片测试;
5.配合DFT或TE工程师完成芯片量产测试;
6.撰写系统架构及相关IP文档;
任职要求:
1.微电子、计算机、通讯工程等相关专业本科以上学历;2.5年以上的ASIC相关设计经验;
3.精通VerilogHDL或SystemVerilog,有良好的编码风格;
4.熟悉AMBA总线,有CPU、GIC、MMU、NOC等开发和调试经验者优先;
5.熟悉Linux/Unix环境,熟悉Perl、Python、TCL脚本语言;
6.具有良好的英文读写能力;
7.具有开拓创新精神、乐于迎接挑战和良好的团队合作精神。
求职提醒:求职过程请勿缴纳费用,谨防诈骗!若信息不实请举报。